硅芯思见：SystemVerilog中枚举类型的一些“不正经”用法

硅芯思见：SystemVerilog中枚举类型的一些“不正经”用法

SystemVerilog中枚举类型虽然属于一种“强类型”，但是枚举类型还是提供了一些“不正经”的用法可以实现一些很常见的功能，本文将示例一些在枚举类型使用过程中的一些“不正经”用法，并给出一些使用建议。

1 同一个作用域内定义多个枚举类型，并且这些枚举类型的枚举值列表中存在相同的标签名

【示例】

【仿真结果】

示例中，定义了两个枚举变量fsm_s1和fsm_s2，并且其对应的枚举值列表中都包含了相同的标签“GO”，编译后报错。其实可以想象下，如果在SystemVerilog的同一个作用域中允许这种同名的标签存在，那么在具体对于某一个枚举变量使用标签进行赋值操作时，那么这个标签到底是来自于哪个枚举变量中对应的枚举列表呢？所以，在SystemVerilog中，同一个作用域内定义多个枚举类型时，这些枚举类型的枚举值列表中不能存在同名的标签。

2 枚举值列表中的标签用于运算

【示例】

【仿真结果】
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原文地址：https://blog.csdn.net/m0_46345246/article/details/126437130

SystemVerilog中枚举类型虽然属于一种“强类型”，但是枚举类型还是提供了一些“不正经”的用法可以实现一些很常见的功能，本文将示例一些在枚举类型使用过程中的一些“不正经”用法，并给出一些使用建议。