Verilog 实现CDC中单bit 跨时钟域，从慢时钟域到快时钟域 - 码农知识堂 - 文章详情页

Verilog 实现CDC中单bit 跨时钟域，从慢时钟域到快时钟域
单bit 跨时钟域，从慢时钟域到快时钟域
- 1，首先，了解一些问题
  
  2，RTL代码设计
  
  3，testbench测试代码
  
  4，RTL代码和testbench综合的电路原理图
  
  5，前仿真，验证![在这里插入图片描述](https://img-blog.csdnimg.cn/adf0a6ae5ee047abaca98f8deb6ed97e.png)
参考文献1，我的专栏，多bitMUX同步器
 参考文献2，本文主要参考

 1，首先，了解一些问题

（1）怎么进行跨时钟域的处理？打两拍进行同步。
（2）同步前后时钟域的快慢延伸出了两种情况：
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